趣味でハードウェア設計

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（2013-04-06 08:27:23 更新差分/履歴 don10ueda ） vimでsystemverilogのシンタックスを有効にする
（2013-04-06 00:31:42 更新差分/履歴 don10ueda ） ModelSimASEでVerilogシミュレーション
（2011-06-11 16:26:49 更新差分/履歴 don10ueda ） DE0
（2011-06-11 15:59:28 更新差分/履歴 don10ueda ） Verilator
（2011-06-11 15:45:46 更新差分/履歴 don10ueda ） Verilator::Lintチェック
（2011-06-07 23:32:34 更新差分/履歴 don10ueda ） Verilator::インストール
（2011-06-07 23:26:30 更新差分/履歴 don10ueda ） Top
（2011-06-07 23:24:58 更新差分/履歴 don10ueda ） MenuBar1
（2011-06-01 22:01:18 更新差分/履歴 don10ueda ） FPGAボード
（2011-06-01 00:42:25 更新差分/履歴 don10ueda ） FPGA
（2011-06-01 00:05:03 更新差分/履歴 don10ueda ） Verilog
（2011-06-01 00:04:55 更新差分/履歴 don10ueda ）開発ツール
（2011-05-31 23:08:16 更新差分/履歴 don10ueda ）トップページ
（2011-05-31 23:06:54 更新差分/履歴 don10ueda ） SystemC
（2011-05-31 22:50:38 更新差分/履歴 don10ueda ） SystemC::インストール
（2011-05-28 21:42:46 更新差分/履歴 don10ueda ） MenuBar2

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